莱迪思解决方案

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  • 10Gb Ethernet MAC+PHY IP Core

    IP Core

    10Gb Ethernet MAC+PHY IP Core

    The Lattice 10G Ethernet (GbE) IP core supports the ability to transmit and receive data between a host processor and an Ethernet network.
    10Gb Ethernet MAC+PHY IP Core
  • 25Gb以太网MAC+PHY IP核

    IP Core

    25Gb以太网MAC+PHY IP核

    莱迪思半导体的25G以太网(GbE)IP核支持在主机处理器和以太网网络之间发送和接收数据。
    25Gb以太网MAC+PHY IP核
  • PCI Express for Avant FPGAs

    IP Core

    PCI Express for Avant FPGAs

    The Lattice PCIe X8 IP Core provides a flexible, high-performance, easy-to-use Transaction Layer Interface to the PCI Express Bus.
    PCI Express for Avant FPGAs
  • QSPI闪存控制器IP核

    IP Core

    QSPI闪存控制器IP核

    QSPI闪存控制器IP可以通过标准、扩展的双/四、双或四通道SPI协议与多个外部SPI闪存器件进行通信。
  • Secure Connected Motion Control Platform

    Reference Design

    Secure Connected Motion Control Platform

    ​​This platform offers resilient connectivity, low power consumption, high performance, and robust security is increasing across various industries.​
    Secure Connected Motion Control Platform
  • USB 2.0/3.2 IP核

    IP Core

    USB 2.0/3.2 IP核

    莱迪思USB 2.0/3.2 IP核提供了一种连接USB主机的解决方案,适用于莱迪思CrossLink-NX FPGA最新器件。
    USB 2.0/3.2 IP核
  • USB到I/O聚合和桥接参考设计

    Reference Design

    USB到I/O聚合和桥接参考设计

    USB到I/O桥接参考设计为支持USB的FPGA提供即插即用外设扩展,还支持从USB到I2C、SPI和GPIO的信号协议转换。
    USB到I/O聚合和桥接参考设计
  • USB到I/O聚合和桥接演示

    演示

    USB到I/O聚合和桥接演示

    USB到I/O聚合和桥接演示展示了莱迪思FPGA的功能,并加速了USB 2.0/3.2(5Gbps)接口创新。
    USB到I/O聚合和桥接演示
  • 莱迪思和英伟达合作开发的网络边缘AI解决方案

    Reference Design

    莱迪思和英伟达合作开发的网络边缘AI解决方案

    该开发板充分集成到NVIDIA IGX/AGX™系统软件中,提供开源支持IP和易于编程的系统控制。
    莱迪思和英伟达合作开发的网络边缘AI解决方案
  • Crosslink-NX PCIe桥接板上的PCIe基础演示

    演示

    Crosslink-NX PCIe桥接板上的PCIe基础演示

    该PCIe基础演示可以控制三个7段LED,并通过PCIe插槽操作FPGA的片上存储器。
    Crosslink-NX PCIe桥接板上的PCIe基础演示
  • PCIe Colorbar Demo for Lattice Nexus-based FPGAs

    演示

    PCIe Colorbar Demo for Lattice Nexus-based FPGAs

    PCIe Colorbar Demo displays a series of moving colorbars by streaming the image data using DMA transfers from the FPGA to the host system.
    PCIe Colorbar Demo for Lattice Nexus-based FPGAs
  • PCIe DMA Throughput Demo for Lattice Nexus-based FPGAs

    演示

    PCIe DMA Throughput Demo for Lattice Nexus-based FPGAs

    The PCI Express DMA Throughput Demo allows to initiate DMA read and write transactions, transferring data from the host to the FPGA and vice versa.
    PCIe DMA Throughput Demo for Lattice Nexus-based FPGAs
  • PCIe Multifunction Demo for Lattice Nexus-based FPGAs

    演示

    PCIe Multifunction Demo for Lattice Nexus-based FPGAs

    Demonstrates the multifunction capabilities of the Crosslink-NX FPGA that allows access to GPIO, MDIO and I2C registers.
    PCIe Multifunction Demo for Lattice Nexus-based FPGAs
  • 用户追踪和旁观者检测演示

    演示

    用户追踪和旁观者检测演示

    该演示示例使用CNN模型,在低功耗通用FPGA上运行,可检测和追踪多个人脸
    用户追踪和旁观者检测演示
  • 目标分类参考设计

    Reference Design

    目标分类参考设计

    该参考设计展示了在网络边缘设备应用中实现基于机器学习的目标分类示例。
    目标分类参考设计
  • 目标分类演示

    演示

    目标分类演示

    该演示提供了在CertusPro-NX FPGA上运行的检测、分类和追踪多个目标的应用示例。
    目标分类演示
  • JESD204B IP核

    IP Core

    JESD204B IP核

    莱迪思JESD204B IP核是用于数据转换器和FPGA器件之间的高速串行接口,用于取代传统接口。
    JESD204B IP核
  • ​​eSPI Target IP核​

    IP Core

    ​​eSPI Target IP核​

    莱迪思eSPI Target IP核符合英特尔eSPI规范,且在用户界面中拥有自己的虚拟线通道。
    ​​eSPI Target IP核​
  •  手势检测

    Reference Design

    手势检测

    使用红外图像传感器实现基于AI的低功耗手势检测系统
     手势检测
  • RISC-V MC CPU IP核

    IP Core

    RISC-V MC CPU IP核

    Propel IP模块:具有可选的定时器和PIC子模块的32位RISC-V处理器核,通过AHB-Lite总线连接到其他Propel各类IP模块。
    RISC-V MC CPU IP核
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