MachXO5™-NX

高级安全控制FPGA

MachXO5-NX是莱迪思的第五代安全控制FPGA产品系列。莱迪思的安全控制FPGA拥有嵌入式闪存、高速I/O和行业领先的安全性,广泛应用于计算、通信和工业市场的系统控制和管理应用。MachXO5-NX在前几代产品的基础上进行了升级,拥有更高的逻辑密度、更快的接口、更大的内部存储器和更强大的安全功能,可实现更复杂的电路板管理设计。

更高的密度、更多存储空间实现复杂的控制应用——25K逻辑密度、1.9 Mb嵌入式存储器和9.2 Mb用户闪存。

高速可靠的IO功能——一贯稳健的I/O操作,1.0 V I/O支持当今的CPU、高速LVDS和MIPI接口。

器件安全保护知识产权——内部闪存配置、AES256位流加密、ECC256位流身份验证、配置端口锁定和运行时安全(Run-time security)。

特性

  • 25K逻辑密度和多达300个I/O引脚
  • 9.2 Mb的用户闪存和片上多重引导配置
  • 使用ECDSA位流认证和AES256加密保障FPGA设计安全
  • Lattice Radiant®和Lattice Propel™软件现已支持该器件
  • Lattice Nexus™平台的低功耗、高稳定性和对ADC和DSP的支持

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产品系列表

MachXO5-NX器件选型指南
特性 LFMXO5-25
逻辑单元
25k
嵌入式存储器(EBR)块(18 kb) 80
嵌入式存储器(EBR)位(kb) 1440
分布式RAM位(kb) 184
分布式RAM位(kb) 184
大型存储器(LRAM)块 1
大型存储器(LRAM)位(kb) 512
18 X 18乘法器 20
ADC模块 2
450 MHz高频振荡器 1
128 kHz低频振荡器 1
GPLL 2
UFM(kb) 15360
0.8 mm引脚封装和I/O总数/(宽范围GPIO/高性能GPIO/专用ADC引脚)

LFMXO5-25
256 BBG (14 mm × 14 mm, 0.8 mm) 206 (160/40/6)
400 BBG (17 mm × 17 mm, 0.8 mm) 306 (252/48/6)

框图

  • 多达25K逻辑单元、1.9 Mb存储器和9.2 Mb专用用户闪存
  • 多达300个可编程I/O,支持1.0/1.2/1.5/1.8/2.5/3.3 I/O电压
  • 通过位流加密和身份验证保护IP
  • 低功耗、低软失效率(SER)、支持SGMII和ADC接口

应用示例

应用:硬件管理

  • 轻松地将硬件管理功能集成到MachXO5-NX和L-ASC10中
  • 支持高速IO和多种电压电平,简化IO桥接和拓展

应用:DC-SCM中的LVDS通道协议和接口(LTPI)

  • 支持LVDS通道协议和接口(LTPI),聚合低速串行接口
  • 实现使用安全控制模块的服务器架构
  • MachXO3、MachXO3D和Mach-NX也支持LTPI

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MachXO5-NX 25K Pinout
FPGA-SC-02038 .9 5/31/2022 CSV 16.8 KB
MachXO5-NX High-Speed I/O Interface
FPGA-TN-02286 .8 5/31/2022 PDF 3.7 MB
MachXO5-NX Family Data Sheet
FPGA-DS-02102 .8 5/31/2022 PDF 3.4 MB
MachXO5-NX Programming and Configuration User Guide
FPGA-TN-02271 1.0 5/31/2022 PDF 2.5 MB
Using TraceID
FPGA-TN-02084 2.3 5/31/2022 PDF 377.7 KB
Minimizing System Interruption During Configuration Using TransFR Technology
FPGA-TN-02198 4.1 6/16/2022 PDF 1.5 MB
Package Diagrams
FPGA-DS-02053 7.0 6/7/2022 PDF 9.5 MB
Memory User Guide for Nexus Platform
FPGA-TN-02094 1.5 7/5/2022 PDF 3.1 MB
High-Speed PCB Design Considerations
FPGA-TN-02178 6.3 5/31/2022 PDF 1.4 MB
Lattice Memory Mapped Interface (LMMI) and Lattice Interrupt Interface (LINTR) User Guide
FPGA-UG-02039 1.2 5/31/2022 PDF 1.7 MB
sysDSP User Guide for Nexus Platform
FPGA-TN-02096 1.4 6/7/2022 PDF 1.9 MB
sysI/O User Guide for Nexus Platform
FPGA-TN-02067 1.6 6/7/2022 PDF 1.5 MB
I2C Hardened IP Usage Guide for Nexus Platform
FPGA-TN-02142 1.3 5/31/2022 PDF 1.4 MB
ADC Usage Guide for Nexus Platform
FPGA-TN-02129 1.4 5/31/2022 PDF 1.9 MB
Soft Error Detection (SED)/Correction (SEC) User Guide for Nexus Platform
FPGA-TN-02076 1.5 5/31/2022 PDF 1 MB
Multi-Boot User Guide for Nexus Platform
FPGA-TN-02145 1.4 6/9/2022 PDF 1.3 MB
Single Event Upset (SEU) Report for Nexus Platform
FPGA-TN-02174 1.2 6/7/2022 PDF 865.6 KB
Reflow Temperature Guidelines and Moisture Sensitivity
FPGA-TN-02041 4.5 4/11/2022 PDF 388.7 KB
Thermal Management
FPGA-TN-02044 4.2 6/7/2022 PDF 1.3 MB
Power Management and Calculation for Certus-NX, CertusPro-NX, and MachXO5-NX Devices
FPGA-TN-02257 1.1 5/31/2022 PDF 1 MB
sysCLOCK PLL Design and User Guide for Nexus Platform
FPGA-TN-02095 2.0 6/7/2022 PDF 2.4 MB
PCB Layout Recommendations for BGA Packages
FPGA-TN-02024 4.9 8/1/2022 PDF 6.6 MB
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MachXO5-NX Family Data Sheet
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MachXO5-NX High-Speed I/O Interface
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MachXO5-NX Programming and Configuration User Guide
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Using TraceID
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Minimizing System Interruption During Configuration Using TransFR Technology
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Memory User Guide for Nexus Platform
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High-Speed PCB Design Considerations
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sysDSP User Guide for Nexus Platform
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sysI/O User Guide for Nexus Platform
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I2C Hardened IP Usage Guide for Nexus Platform
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ADC Usage Guide for Nexus Platform
FPGA-TN-02129 1.4 5/31/2022 PDF 1.9 MB
Soft Error Detection (SED)/Correction (SEC) User Guide for Nexus Platform
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Multi-Boot User Guide for Nexus Platform
FPGA-TN-02145 1.4 6/9/2022 PDF 1.3 MB
Single Event Upset (SEU) Report for Nexus Platform
FPGA-TN-02174 1.2 6/7/2022 PDF 865.6 KB
Reflow Temperature Guidelines and Moisture Sensitivity
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Power Management and Calculation for Certus-NX, CertusPro-NX, and MachXO5-NX Devices
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sysCLOCK PLL Design and User Guide for Nexus Platform
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MachXO5-NX 25K Pinout
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Lattice Memory Mapped Interface (LMMI) and Lattice Interrupt Interface (LINTR) User Guide
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Lattice OrCAD Capture Schematic Library (OLB)
This file contains an OrCAD Capture Schematic Library (OLB file type) for all Lattice products. This .zip file also includes a .xls worksheet with a list of the contents of the OLB. These symbols can be used to help with OrCAD schematic designs.
FPGA-SC-02005 7.4 6/1/2022 ZIP 4.4 MB
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在莱迪思FPGA中实现DC-SCM
WP0031 1.0 5/31/2022 PDF 1.2 MB
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[BSDL] LFMXO5-25
FPGA-MD-02027 1.14 5/31/2022 ZIP 18.9 KB
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MachXO5-NX Device Family Delphi Models
FPGA-MD-02031 .8 5/31/2022 ZIP 17.4 KB
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[IBIS] MachXO5-NX
FPGA-MD-02035 1.0 5/31/2022 ZIP 10.8 MB

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