IP ExpressSPI4知识产权(IP)核在莱迪思可编程门阵列(FPGA)中实现了符合OIF标准的系统数据包接口第4级第2阶段版本1(SPI4.2.1)的用户实例化内核。SPI4 IP核支持多达256个数据通道和3到12.8Gbps的总吞吐量,用于连接带有OC192成帧器的网络处理器、映射器和逻辑结构,以及千兆和10千兆以太网MAC。

特性

  • 软SPI4 IP核完全符合OIF系统数据包接口第4级第2阶段版本1(SPI4.2.1)接口标准
  • 支持通过Diamond或ispLEVER IPexpress™工具,方便用户配置和参数设置
  • 支持多达256个独立通道
  • LatticeSC和LatticeSCM器件中400至500MHz的DDR动态工作模式
  • LatticeECP3器件156至350MHz DDR的静态时序模式工作。支持非标准的"SPI4精简版"线路速率。
  • 支持64b和128b的内部架构,用于速度或资源优化
  • 一个全256通道静态模式的内核仅需2000 slice(64b模式)
  • 支持SPI4线两个方向上的全带宽利用率——突发脉冲之间,接收方向无需空闲周期,发送方向无需插入空闲周期(只要有可用数据)
  • 所有接收和发送控制和数据字(DIP4)和状态(DIP2)接口上的奇偶错误校验/产生
  • 数据的奇偶错误强制功能(独立控制:控制字和数据)和状态接口
  • 各种用户控制运行时间
    • 强制空闲(发送器)
    • 使能/禁止打包(发送器)
    • 训练模式(CAL_M, MAX_T)
  • 所有内部FIFO阈值的所有运行时间可编程,可用于有效的SPI4线Lmax和打包管理
  • SPI4接口提供了直接接口到主器件I/O,以及一个内部FIFO接口到用户逻辑
  • 支持16字节的最小传输突发流量大小从16字节增加到最高1008字节,适用于优化的网络处理器应用
  • 支持数据包小至4个字节长度
  • 完全可配置的Rx和Tx方向512个calendar RAM,以及相关的256个状态RAM
  • 两个独立可配置的状态报告方法,接收和传输方向——RAM可寻址和Transparent
  • 上升沿或下降沿可选状态通道,在接收和发送方向I/O独立可配置

SPI4可作为一个IPexpress用户可配置的IP核,能够进行IP的配置,生成网表和模拟文件用于设计。请注意,除非购买这个IP 的许可证,否则可能不能生成位流,或比特流可能有时间逻辑。

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块关系图

性能和大小

LatticeECP31
配置 SLICE LUT REG I/O EBR 线速率(MHz)
总线宽度 状态模式
64 Transparent 2324 2600 3206 80 12 312
128 RAM 3967 4327 5185 80 18 350

1.性能和资源使用情况数据是通过使用LFE3-70EA-8FN672CES器件和Lattice Diamond 1.0和Synplify Pro D-2009.12L-1软件测得的。当使用不同软件版本或者LatticeECP3系列中不同密度或速度级的器件实现该设计,性能可能会有所不同。

LatticeSC/M1
配置 SLICE LUT REG I/O EBR 线速率(MHz)
总线宽度 状态模式
64 Transparent 2405 5126 3001 80 12 400
128 RAM 4015 5126 4840 80 18 400

1.性能和资源使用情况数据是通过使用LFSC3GA25E-6FF1020C器件和Lattice Diamond 1.0以及Synplify Pro D-2009.12L-1软件测得的。当使用不同软件版本或者LatticeSC/M系列中不同密度或速度级的器件实现该设计,性能可能会有所不同。

订购信息

系列 部件编号
LatticeECP3 SPI-42-E3-U3
LatticeSC/M SPI-42-SC-U3

IP版本:2.8

评估:欲下载该IP的完整评估版,请访问IPexpress工具并点击工具条上的IP服务器按钮。上面显示了所有可供下载的LatticeCORE IP核和模块。欲了解更多查看/下载IP核的信息,请阅读IP Express快速入门指南

购买:欲了解如何购买IP核,请联系您本地的莱迪思销售办事处

文档

快速参考
资讯资源
标题 编号 版本 日期 格式 文件大小
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Soft SPI4 IP Core User's Guide
IPUG59 01.7 9/16/2010 PDF 1.8 MB
标题 编号 版本 日期 格式 文件大小
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IPexpress Quick Start Guide
8/5/2010 PDF 304.8 KB