Certus-NX

低消費電力汎用FPGA

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Certus-NX Whitepaper

小型パッケージで業界をリードするI/O数を提供：同等のFPGAと比較して1mm2あたり最大2倍のI/O数を6 x 6 mmと小型のパッケージで提供し、PCIeとGigE（SGMII）をサポート

高速インタフェース：1.5Gbpsと最大70%高速化した差動I/O（同等のFPGAと比較）。5Gbps PCIe、1.25Gbps SGMII（GigE）、1066Mbps DDR3メモリ・インタフェースもサポート

Lattice Nexusプラットフォームで開発：同等FPGAと比較して最大4分の1の消費電力。28nm FD-SOI技術の採用によりソフトエラー・レート（SER）を100分の1に低減し、信頼性を100倍向上

Certus-NX

機能

  • 最大39Kのロジック・セル、2.9Mbのエンベデッド・メモリ、56の18 x 18マルチプライヤ、192のプログラマブルI/O、1レーンの5Gbps PCIe、2レーンの1.25Gbps SGMII、2つのADC（各12ビット、1MSPS）
  • 6 x 6 mmと小型のパッケージ、ボールピッチ・オプションは0.5mmと0.8mm
  • 消費電力モード：FD-SOIプログラム可能なバック・バイアスにより実現するユーザー選択可能な低消費電力モードと高性能モード
  • デザインのセキュリティ：ECDSAによるビットストリーム認証と、堅牢なAES-256 による暗号化
  • インスタント・オン構成：I/O構成は3ミリ秒、チップ全体の起動は8ミリ秒と高速

各項目へのリンク

ファミリーテーブル

Certus-NX Device Selection Guide
Features LFD2NX-17 LFD2NX-40
Logic Cells 17K 39K
Embedded Memory (EBR) Bits (Kb) 432 1512
Large Memory (LRAM) Bits (Kb) 2560 1024
18 X 18 Multipliers 24 56
ADC Blocks 2 2
GPLL 2 3
5 Gb/s PCIe Gen2 Hard IP — 1
Full-chip Configuration Time1 (ms) 8 14
I/O Configuration Time1 (ms) 3 3
0.5 mm Total I/O (Wide Range, High Performance), PCIe Lane

LFD2NX-17 LFD2NX-40
121 csfBGA (6 x 6 mm) 78 (30, 48), 0 82 (24, 58), 1
0.8 mm Total I/O (Wide Range, High Performance), PCIe Lane

LFD2NX-17 LFD2NX-40
196 caBGA (12 x 12 mm) — 157 (99, 58), 0
256 caBGA (14 x 14 mm) — 192 (118, 74), 1

1. QSPI mode at 150 MHz nominal frequency

ソリューション

PCIe to SGMII Bridge Block Diagram with Certus-NXExpand Image

PCIeからSGMIIへのブリッジ

  • PCIe Gen2経由でのSGMIIへのブリッジ・プロセッサ
  • PCIeとSGMIIに対応し、6 x 6 mmと小型のパッケージ
  • PCIe Gen2とSGMII CDRのハード・ブロックにより開発を容易に
PCIe Control Place Bridge Block Diagram with Certus-NXExpand Image

PCIe制御プレーン・ブリッジ

  • PCIe Gen2経由での、複数の制御プレーン・ペリフェラル（UART、SPI、I2C、MDIOなど）や基板管理機能へのブリッジ・プロセッサ
  • 1mm2あたりのプログラマブルI/O数の多いパッケージにより、所定のフォームファクタでインタフェース数を最大化
  • 多機能サポートを内蔵したPCIeハードIPにより開発を簡素化
  • インスタント・オン構成が基板管理ニーズとPCIe起動時間要件をサポート
Co:processing Block Diagram with Certus-NXExpand Image

コプロセッシング

  • Certus-NXをコプロセッサとして使用することによりCPUをオフロードし、複雑な機能を高速化
  • DDR3 & LPDDR2インタフェース・サポート（最大1066Mbps）とオンチップ・エンベデッド・メモリ（最大2.9Mbit）がデータ・バッファリングに複数のオプションを提供
  • PCIeとDDRメモリ・インタフェースに対応する6 x 6 mmと小型のパッケージ
Motor Control Block Diagram with Certus-NXExpand Image

モーター制御

  • モーター制御機能の効率と性能を向上
  • 28nm FD-SOIプロセス技術によりソフトエラー・レート（SER）を100分の1に低減し、高い信頼性を提供
  • 産業用温度範囲に対応

デザインリソース

開発キット＆ボード

当社の開発キットとボードで設計プロセスの合理化

IP ＆ リファレンスデザイン

事前検証済み、開発期間を短縮

開発ソフトウェア

使いやすく、開発に必要な機能を提供

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