MIPI CSI-2送信ブリッジ

CSI-2トランスミッタ参照デザイン

MIPI(Mobile Industry Processor Interface)ベースの AP(Application Processor、アプリケーションプロセッサ)は驚異的な集積度を低消費電力かつ低コストで実現していることから、コンスーマモバイル市場以外の多様なデザインにも使用できます。ただし、モバイルアプリケーション用に設計されていないイメージセンサとAPとのインターフェイスが必要な場合は、変換ブリッジが必要になります。例えば、組み込み機器やデジタルカメラ市場を対象としたイメージセンサは、subLVDSなどのCSI-2(Camera Serial Interface)以外の独自インターフェイスを持つことが良くあります。パラレル・CSI-2トランスミッタ参照デザインを使用すると、ラティスセミコンダクターのFPGAでブリッジ機能を容易に実装できます。

パラレル・CSI-2変換の参照デザインは、各種MIPI非対応イメージセンサとAPやISP(Image Sensor Processor)の接続にラティスの超小規模FPGAがまさにフィットすること示しています。

柔軟なMIPI CSI-2送信ブリッジ ~ CSI-2トランスミッタ参照デザインを使用することで、組み込みイメージセンサ用途で低コストなAPやISPを利用できるようになります。

MIPI CMOS Diagram

特長

  • MIPI CSI-2受信デバイスとのインターフェイス
  • 最大4データレーンのCSI-2を最速900Mbpsまで
  • 700Mbps動作の2データレーン・ブリッジの消費電力は20mW typ.
  • 700Mbps動作の4データレーン・ブリッジの消費電力は 32mW typ.
  • 片方向HS(High Speed)モードに対応
  • 双方向LP(Low Power)モードに対応
  • ピクセルバスは各ビット幅の入力が可能
  • CSI-2互換ビデオ形式(RAW、YUV、RGB)に対応

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ブロック図

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ドキュメント

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MIPI DPHY DSI/CSI-2 Example Schematic
1.0 10/29/2013 PDF 72.6 KB
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Parallel to MIPI CSI-2 TX Bridge - Documentation
FPGA-RD-02132 1.6 8/19/2021 PDF 1.1 MB
MIPI D-PHY Interface IP - Source Code
RD1182 1.7 10/14/2020 ZIP 5.3 MB
Parallel to MIPI CSI-2 TX Bridge - Source Code
RD1183 1.5 1/1/2015 ZIP 1.2 MB
LatticeECP3 RAW10 2L
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LatticeXP2 RGB888 1L
RD1183 6.0 8/18/2015 ZIP 1.6 MB
LatticeXP2 RGB888 2L
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LatticeECP3 RGB565 4L
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LatticeECP3 RAW10 4L
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MachXO3 YUV422 10b 4L
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LatticeXP2 RGB444 1L
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MachXO3 RAW14 1L
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MachXO3 RAW12 1L
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MachXO3 RAW8 2L
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MachXO3 RAW8 4L
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LatticeXP2 RAW10 1L
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MachXO3 RAW10 1L
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MachXO3 YUV422 8b 4L
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ECP5 RGB888 4L
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LatticeECP3 YUV422 8b 2L
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LatticeXP2 RAW12 2L
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LatticeECP3 YUV422 10b 4L
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LatticeECP3 RAW8 4L
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LatticeECP3 RAW 10b 1L
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LatticeECP3 RGB888 1L
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LatticeECP3 RGB888 2L
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LatticeECP3 YUV422 10b 2L
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MachXO3 RAW12 4L
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MachXO3 RAW8 1L
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MachXO3 YUV422 8b 1L
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MachXO3 RAW10 2L
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MachXO2 YUV422 8b 1L
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MachXO2 YUV422 10b 2L
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MachXO2 RAW12 1L
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MachXO2 RGB666 4L
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MachXO2 YUV420 8b 4L
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MachXO2 RAW10 4L
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MIPI D-PHY Reference Design - Documentation
FPGA-RD-02040 1.7 9/11/2020 PDF 2.4 MB
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MIPI Display Serial Interface Solution Product Flyer
I0241 2.0 10/22/2013 PDF 1.8 MB
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Multi-time Programmable ULD FPGAs
1.0 12/1/2013 PDF 163.5 KB

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