MIPI CSI-2送信ブリッジ

CSI-2トランスミッタ参照デザイン

MIPI(Mobile Industry Processor Interface)ベースの AP(Application Processor、アプリケーションプロセッサ)は驚異的な集積度を低消費電力かつ低コストで実現していることから、コンスーマモバイル市場以外の多様なデザインにも使用できます。ただし、モバイルアプリケーション用に設計されていないイメージセンサとAPとのインターフェイスが必要な場合は、変換ブリッジが必要になります。例えば、組み込み機器やデジタルカメラ市場を対象としたイメージセンサは、subLVDSなどのCSI-2(Camera Serial Interface)以外の独自インターフェイスを持つことが良くあります。パラレル・CSI-2トランスミッタ参照デザインを使用すると、ラティスセミコンダクターのFPGAでブリッジ機能を容易に実装できます。

パラレル・CSI-2変換の参照デザインは、各種MIPI非対応イメージセンサとAPやISP(Image Sensor Processor)の接続にラティスの超小規模FPGAがまさにフィットすること示しています。

柔軟なMIPI CSI-2送信ブリッジ ~ CSI-2トランスミッタ参照デザインを使用することで、組み込みイメージセンサ用途で低コストなAPやISPを利用できるようになります。

MIPI CMOS Diagram

特長

  • MIPI CSI-2受信デバイスとのインターフェイス
  • 最大4データレーンのCSI-2を最速900Mbpsまで
  • 700Mbps動作の2データレーン・ブリッジの消費電力は20mW typ.
  • 700Mbps動作の4データレーン・ブリッジの消費電力は 32mW typ.
  • 片方向HS(High Speed)モードに対応
  • 双方向LP(Low Power)モードに対応
  • ピクセルバスは各ビット幅の入力が可能
  • CSI-2互換ビデオ形式(RAW、YUV、RGB)に対応

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ブロック図

CSI-2 Tx block diagram

ドキュメント

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TITLENUMBERVERSIONDATEFORMATSIZE
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MIPI DPHY DSI/CSI-2 Example Schematic
1.010/29/2013PDF72.6 KB

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LatticeECP3 RGB888 2L
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LatticeECP3 YUV422 10b 2L
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MachXO3 YUV422 8b 4L
RD11836.08/18/2015ZIP649.6 KB
MIPI D-PHY Interface IP - Source Code
RD11821.710/14/2020ZIP5.3 MB
MIPI D-PHY Reference Design - Documentation
FPGA-RD-020401.79/11/2020PDF2.4 MB
Parallel to MIPI CSI-2 TX Bridge - Documentation
FPGA-RD-021321.68/19/2021PDF1.1 MB
Parallel to MIPI CSI-2 TX Bridge - Source Code
RD11831.51/1/2015ZIP1.2 MB
TITLENUMBERVERSIONDATEFORMATSIZE
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MIPI Display Serial Interface Solution Product Flyer
I02412.010/22/2013PDF1.8 MB
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Multi-time Programmable ULD FPGAs
1.012/1/2013PDF163.5 KB

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