LPDDR SDRAM コントローラ

IP ExpressLPDDR SDRAM (Synchronous Dynamic Random Access Memory)コントローラは、汎用メモリコントローラで、JESD209B規格準拠の業界標準LPDDRメモリデバイス/モジュールとインターフェイスし、またユーザ・アプリケーション用の汎用コマンド・インターフェイスを提供します。このIPコアにより、ユーザはLPDDRメモリインターフェイスに対処する必要が最小化されるため、LPDDRメモリコントローラを他のアプリケーション回路と統合するために必要な労力を低減できます。

特長

  • JESD209B準拠の業界標準LPDDR SDRAMとのインターフェイス
  • ダブルデータレート・アーキテクチャ
  • データバイトごとの双方向データストローブ(DQS)
  • プログラマブルな自動リフレッシュに対応
  • データマスクに対応 ~ バイトあたりマスク一本
  • パワーダウンとディープ・パワーダウンに対応
  • 電源オン初期化に対応
  • ディープ・パワーダウン後の再初期化に対応
  • 初期化後のダイナミックI/Oトレーニング
  • 自動リフレッシュ・バースト後の周期的なI/O再トレーニング
  • セルフリフレッシュ、パワーダウン、およびディープ・パワーダウン動作時の、メモリクロック電源のダイナミックなオフ制御
  • シングルポート動作に対応
  • フル / ハーフ / クォータ各アレイ対応のセルフリフレッシュ
  • ステータスレジスタの読み出しに対応
  • MRSによるTCSRプログラムが可能

LPDDR SDRAMコントローラはIPexpressのユーザ構成可能なIPコアとして用意されており、これはIPのパラメータ設定やデザインで使用するためのネットリストとシミュレーション用ファイルの生成が可能な形式のものです。IPのライセンスが未購入の場合、ビットストリームで時限ロジックが有効になるか、またはビットストリームの生成ができないことにご留意ください。

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ブロック ダイアグラム

パフォーマンスとサイズ

MachXO21
IP コア パラメーターの設定 2 SLICEs LUTs レジスタ I/O PAR 開始点 fMAX (MHz)
LPDDR SDRAM
コント ローラーの構成 1
ユーザガイド Table 3-1
のデフォルト・パラメータ時
814 1530 911 149 1 136.4
LPDDR SDRAM
コント ローラーの構成 2
705 1314 804 149 1 136.6
LPDDR SDRAM
コント ローラーの構成 3
729 1409 969 143 1 142.9
LPDDR SDRAM
コント ローラーの構成 4
729 1409 969 143 1 142.9

1. パフォーマンスと使用率データは、ラティスDaimond 1.3 デザイン ソフトウェアで LCMXO2-7000HE-6BG256C デバイスを使用して生成されます。パフォーマンスは別の密度、速度またはグレード MachXO2 ファミリ内でこの IP コアを使用するときに異なる場合があります。
2. 16ビットのSDRAMデータパス幅

発注情報

家族 パートナンバー
MachXO2 LPDDRCT-WB-M2-U

IP バージョン: 1.0.

このIPの完全評価バージョンをダウンロードするには、IPエクスプレスのメイン・ウィンドウにあるラティスIPサーバへ行ってください。ダウンロードできる全てのラティス IPモジュールは、このタブ上でご覧になれます。

IP コアを購入する方法を見つけるためにローカル格子営業所までご連絡ください。

ドキュメント

Quick Reference
TITLE NUMBER VERSION DATE FORMAT SIZE
LPDDR SDRAM Controller IP Core User's Guide
IPUG92 1.3 2/1/2014 PDF 2.6 MB

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