HDR-60摄像机开发套件

采用LatticeECP3 FPGA的高动态范围(HDR)摄像机系统

莱迪思HDR-60摄像机开发套件是一款完全可量产的高动态范围(HDR)摄像机,开发套件外形大小符合市售摄像机外壳尺寸。硬件设计成能够支持每秒60帧的全1080p分辨率,以流模式通过FPGA而不需要任何外部帧缓冲。

莱迪思的合作伙伴Helion GmbH的集成IONOS图像信号处理(ISP)IP核流水线提供端至端的ISP支持,从传感器到显示图像,整合了传感器接口、有缺陷的像素校正及2D降噪、高品质5 × 5 DeBayer、色彩校正矩阵、快速自动曝光、自动白平衡、HDR、伽玛校正和覆盖(包括字符和图形)。莱迪思的HDMI PHY IP可输出至HDMI/ DVI显示器。

该套件提供了业界最快的自动曝光,质量非常高的自动白平衡,HDR大于120dB。板上的Broadcom Broadreach™ PHY支持以太网,通过同轴电缆传输最远可达700米的距离。此外,硬件支持高达16兆像素的传感器,可以同时支持2个传感器,很容易通过标准的低成本USB电缆进行编程。

该套件由两块板组成,长形的HDR - 60底板和安装在底板顶部的方形Nanovesta传感器板。该底板带有莱迪思的LatticeECP3-70,而传感器板配备了Aptina公司720p高动态范围(HDR)传感器。然而,硬件设计成支持每秒60帧的全1080p分辨率。

当连接到HDMI或DVI显示器时,套件包含了开箱即可使用的每秒60帧的即插即用的演示。利用莱迪思FPGA的高性能、低功耗数字信号处理功能,摄像机制造商能够使设计迅速启动,套件的所有购买者都可免费获取演示示例比特流、电路板原理图和Gerber文件。

而配有莱迪思ECP3 - 70套件给摄像机制造商提供了充足的空间来集成他们自己的IP,整个IONOS HDR图像信号处理(ISP)流水线能够与LatticeECP3-35器件完美结合。事实上ISP流水线不需要外部的帧缓冲器,LatticeECP3 FPGA的低功耗使得基于HDR-60的摄像机拥有极低的构建和工作成本。

特性

  • 基于FPGA的图像信号处理
  • 完全可量产的HDR摄像机设计
  • 实现了每秒60帧的1080p功能
  • 支持高达16兆像素的传感器
  • 同时支持两个传感器
  • 流模式下的完整60fps,不需要外部帧缓冲器
  • 根据变化的光线进行即时快速的自动曝光调整
  • 高于120dB的高动态范围(HDR)性能
  • 来自FPGA的直接HDMI / DVI输出
  • 超低延迟
  • 丰富的图像处理IP库
  • 通过同轴电缆,板上Broadcom® Broadreach™ PHY使能 IP
  • 板上FTDI器件通过低成本的USB电缆提供便捷的编程

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开发套件内包括

  • HDR-60底板
  • 9MT024 NanoVesta前板(仅-DKN版本有)
  • 2根USB线
  • HDMI线
  • HDMI-DVI适配器
  • 12V电源(国际电压)
  • 快速入门指南

开发板照片

俯视图,HDR-60底板带有NanoVesta前板

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俯视图,HDR-60底板不带NanoVesta前板

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侧视图,HDR-60底板带有NanoVesta前板

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订购信息

  • 该产品已下架。本页面的信息仅供参考。
  • 部件订购编号:
    • LFE3-70EA-HDR60-DKN - 包括NanoVesta前板
    • LFE3-70EA-HDR60-EVN - 不包括NanoVesta前板

文档

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Programming Cable User Guide
Describes the features and recommended usage guidelines of Lattice ispDOWNLOAD Cables.
FPGA-UG-02042 26.4 5/29/2020 PDF 1.4 MB
HDR-60 Base Board - Revision A User's Guide
EB59 01.1 8/6/2012 PDF 3.1 MB
HDR-60 Video Camera Development Kit Quick Start Guide
QS010 11/6/2012 PDF 1.3 MB
HDR-60 Base Board - Revision B User's Guide
EB70 1.2 4/9/2014 PDF 3.4 MB
MT9M024 NanoVesta Head Board User's Guide
EB63 01.1 5/8/2012 PDF 1 MB
MachXO2 Dual Sensor Interface Board User's Guide
EB69 1.1 1/5/2012 PDF 2.4 MB
标题 编号 版本 日期 格式 文件大小
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HiSPi-to-Parallel Sensor Bridge
FPGA-RD-02069 1.4 4/1/2014 PDF 1013.1 KB
标题 编号 版本 日期 格式 文件大小
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LatticeECP3 Family Product Brochure
I0198 8.0 5/29/2012 PDF 2.7 MB
摄像机解决方案
IO232C 4/25/2013 PDF 1.7 MB
HDR-60 Video Camera Development Kit Product Brief
I0213 4/6/2012 PDF 1.9 MB
HDR-60 Video Camera Development Kit Product Brief (Chinese Language Version)
I0213C 4/1/2012 PDF 2.3 MB
IP Suites for LatticeECP3 - News Brief
NB101 2/4/2011 PDF 458.8 KB
Dual Image Sensor Product Brief
4/3/2012 PDF 1.2 MB
标题 编号 版本 日期 格式 文件大小
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NanoVesta BOM Rev A
2/22/2011 XLS 34 KB
NanoVesta PCB Layout Rev A
2/22/2011 ZIP 1.2 MB
NanoVesta Photoplots Rev B
1/20/2012 ZIP 714.3 KB
NanoVesta Schematic Rev A
2/22/2011 ZIP 357.5 KB
MT9M024 NanoVesta Rev B Layout
Layout files in .brd format for the 9MT024 NanoVesta Rev B
5/6/2011 ZIP 897.9 KB
NanoVesta BOM Rev B
1/20/2012 XLS 41 KB
NanoVesta Schematic Rev A or B
Boards marked with Rev A or B have a common schematic. These revisions differ only in the layout.
1/20/2012 ZIP 465.1 KB
Nanovesta PCB Photoplots Rev A
2/22/2011 ZIP 759.8 KB
MN34041 Sensor NanoVesta Headboard Bitstream
© Helion GmbH, Germany, 2011-2013
3/21/2012 BIT 2.5 MB
Using Lattice HDR-60 With Aptina DevWare
3/15/2011 ZIP 1.1 MB
HDR-60 BOM Rev A
2/22/2011 XLS 57.5 KB
HDR-60 PCB Photoplots Rev A
2/22/2011 ZIP 1.1 MB
HDR-60 BOM Rev B
List of all components populated on the HDR-60 base board.
1/25/2012 XLS 66.5 KB
HDR-60 Schematic Rev B
Schematic files in OrCAD .dsn and .pdf formats
3/1/2012 ZIP 659.5 KB
HDR-60 Gerber Files Rev B
1/25/2012 ZIP 1.1 MB
HDR-60 Default Programming Bit Streams and Graphical User Interface files
© Helion GmbH, Germany, 2011-2013
1/28/2013 ZIP 7.6 MB
HDR-60 PCB Rev B
Layout source files for HDR-60 base board - Rev B
1/25/2012 ZIP 2.1 MB
HDR-60 Schematic Rev A
2/22/2011 ZIP 801.9 KB
HDR-60 PCB Layout Rev A
2/22/2011 ZIP 2.1 MB
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Helion ISP Pipeline
1/1/0001 JPG 124.1 KB

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