EP510: CompactFlash/PCMCIA 主机适配器

主机适配器支持所有在PC卡/ PCM-CIA / CF卡标准中定义的四种访问类型,包括针对ISA总线的存储器和IO访问、常用的存储器、和用于PC卡/ PCMCIA 的属性存储器和IO访问。主机适配器允许主机CPU访问PC卡/ PCMCIA和CompactFlash卡。有不同的用户接口选项。在最基本的形式里,该核包含了一个简单的用户接口,针对片上连接进行了优化。在通用微处理器接口之后仿制了用户接口。

该核也可以集成其他CPU总线从设备,直接与其他的嵌入式CPU接口。支持的CPU 为ARM(用AMBA AHB总线)、PowerPC(用60X总线或MPC860总线),MIPS(用SysAD总线或EC接口)、ARC和Hitachi SH2、SH3和SH4嵌入式处理器。

主机适配器支持不同类型的常用存储器的访问,属性存储器的访问和PC卡/ PCMCIA / CompactFlash的IO访问。它也支持CompactFlash中的 True IDE模式。提供针对CPU的不同的芯片选择信号,或选择访问地址空间的用户逻辑。

基本的CPU接口可以是32位或64位,而卡接口可以是8位或16位。支持CPU的突发和单数据访问。当CPU请求从卡读出32位的数据时,主机适配器执行多个8位或16位的读操作,为CPU收集32位数据。当CPU写32位数据到卡时,主机适配器执行多个8位或16位写入到卡上,写入所有的数据。主机适配器不支持突发访问。

主机适配器提供直接的地址映射,由芯片选择输入信号选择地址空间。可以根据客户的要求提供定制的地址翻译方案。

主机适配器工作在两个时钟域,用户接口时钟域和卡接口时钟域。用户接口时钟的上升沿时序控制用户接口上的所有I / O信号。卡接口时钟的上升沿时序控制卡接口的所有I/ O信号。当数据在时钟域之间传输时,使用请求/应答和双同步。这种设计方法允许在用户接口运行在较高的CPU总线时钟频率,而卡接口运行在较低的时钟频率。

Features

  • Compliant with PC Card Standard 8.0, PCMCIA 2.1/JIEDA 4.2 and Compact-Flash 1.4
  • Allows host bus devices to access CompactFlash and PC Card/PCMCIA devices.
  • Simple user interface optimized for on-chip bus connection.
  • Dual clock design allows the user interface and the Card interface to operate at different clock domains.
  • User interface supports 32-bit and 64-bit data.
  • Option to integrate with other CPU bus slaves to support direct access by various CPU's including PowerPC, MPC860, ARM, SH2/3/4, MIPS, and ARC microprocessors.
  • Option to support 82365SL-compatible and EXCA register set
  • In PC Card/PCMCIA mode, supports attribute memory access, common mem-ory access and IO access.
  • In CompactFlash mode, supports attribute memory access, common memory access, IO access and IDE mode access.
  • Converts 64/32-bit CPU access to multiple 8-bit or 16-bit accesses.
  • Supports burst access by CPU. Burst access dispatched as multiple single accesses to the CompactFlash/PCMCIA interface.
  • Direct mapping of host address space to card address space.
  • CPU may operate at higher frequency while the card interface operates at lower frequency.
  • Designed for ASIC and FPGA implementations.
  • Fully static design with edge triggered flip-flops.

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Block Diagram

性能和大小

以下是典型的性能和利用率的结果。

器件 利用率 性能
PFUs Slices LUTs 百分比
LFX1200B-4 150 466 4% 63 MHz
LFEC20 482 4% 80 MHz
LFXP10 482 9% 88 MHz
LFXP2-17E 354 4% 150 MHz
LFE2-12E 343 6% 150 MHz
LFSC3GA15E 377 4% 200 MHz

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CompactFlash/PCMCIA Host Adapter Datasheeet
EP510 6/22/2007 PDF 123.3 KB