DisplayPort IP核

适用于低功耗FPGA的DisplayPort和嵌入式DisplayPort IP

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Embedded Vision Development Kit

莱迪思和Bitec倾力合作，推出适用于低功耗、批量低价格ECP5器件的DisplayPort 1.4a IP核 (支持eDP 1.4)。

该IP核具有丰富的参数设置，为系统设计师针对消费电子、工业和汽车应用设计进行了优化。

该IP中使用了ECP5 SERDES，支持四通道，每通道传输速率高达2.7 Gbps，最高支持1080p60分辨率。

  • DisplayPort 1.4a (包含eDP 1.4) 支持1、2 和4通道的发送器和接收器
  • 多位色彩深度，支持RGB或YCbCr格式
  • 支持嵌入式DisplayPort (eDP) 特性
  • 支持八通道音频和可选内容保护（HDCP）

订购信息

  • 本IP核由BITEC销售并提供支持。

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框图

Bitec DisplayPort IP Block Diagram放大图片
  • DisplayPort 1.4标准，支持1、2 & 4通道
  • 支持1.62 Gbps或2.7 Gbps链路速率
  • 双符号和四符号模式支持单、双和四像素模式
  • 4、8、10、12和16位色，支持RGB或YCbCr格式

Design Resources

DisplayPort IP核

IP Core

DisplayPort IP核

Lattice has partnered with Bitec to bring the DisplayPort 1.4a compliant IP Core (with eDP 1.4 support) to the ECP5 FPGA. Supports resolutions of up to 1080p60
ECP5 / ECP5-5G, CertusPro-NX 
DisplayPort, Video Tx/Rx, Lattice mVision 
DisplayPort IP核

文档

快速参考
资讯资源
标题 编号 版本 日期 格式 文件大小
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Bitec DisplayPort Lattice Integration Manual
Note: for latest documents please contact Bitec directly. 		1.0 3/28/2018 PDF 481 KB
DisplayPort VIP Output Board Evaluation Board User Guide
FPGA-EB-02015 1.0 4/21/2018 PDF 653 KB
标题 编号 版本 日期 格式 文件大小
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Bitec DisplayPort IP Product Brief
2.0 6/25/2021 PDF 174.9 KB

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