32ビットPCIマスター/ターゲット

ラティスのPCI(Peripheral Component Interconnect)は遠隔通信、組込みシステム、高性能周辺カードとネットワーキングを含む様々なアプリケーションに使用されている広く認知されたバス標準です。

ラティスのPCIコアは今日の高性能なPCIアプリケーションのニーズにあう理想的なソリューションを提供します。これは完全に66MHzまでのスピード用PCIローカルバス仕様 rev.2.2に準拠します。PCIマスター/ターゲットコアはカスタマイズできる32ビットもしくは64ビットマスター/ターゲット・ソリューションを提供します。完全に同期化されたPCI-64/66マスター/ターゲット・コアは、マスター/ターゲットと統合されたPCIソリューションを提供する具体的な設計アプリケーションのギャップの橋渡しをします。PCIマスター/ターゲット・ソリューションはより速く製品市場投入となるよう設計者がPCI仕様よりアプリケーションに集中できるようにしました。

ラティスのPCIで提供される機能は32ビットPCI、64ビットPCI、32 ビット・ローカルバス、64ビット・ローカルバス、マスター/ターゲットとターゲット・アプリケーションをカバーする複数の構成中において可能です。このドキュメントには、64ビット動作と該当したときのみに適応するマスター動作の詳細が含まれています。このデータシートの付録では、どのデバイスに何のコアが有効なのかを明記しています。

特長

  • 32/64ビットPCIバス及び32/64ビットローカルバスを用意
  • マスター/ターゲット及びターゲット版を用意
  • PCI SIGローカルバス仕様、リビジョン2.2準拠
  • 64ビットアドレス・サポート
  • リスト・ポインタ・サポート
  • パリティ・エラー検出
  • 最大6個のベース・アドレス・レジスタ(BAR)と拡張ROM・BARサポート
  • 高速バック・ツー・バック・トランザクション・サポート
  • 待ち時間なしのステート・トランザクション・サポート
  • 特別なサイクル・トランザクション・サポート
  • カスタマイズ可能な構成スペース
  • 最高66MHzまでのPCI
  • 完全同期設計

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ブロック ダイアグラム

パフォーマンスとサイズ

LatticeECP31
バス幅 IPexpress モード SLICEs LUTs レジスタ sysMEM EBRs 外部端子 fMAX (MHz)
32-ビット マスター/ターゲット 33 MHz 683 1059 640 - 50 33
32-ビット マスター/ターゲット 66 MHz 1076 1691 661 - 50 66

1. パフォーマンスと使用率データは、ラティスDiamond 1.0 ソフトウェアと、LFE3-95EA-7FN1156CES デバイスを使用して生成されます。パフォーマンスが異なる場合があります別のソフトウェア バージョンを使用してまたは LatticeECP3 家族の内で別のデバイス密度や速度のグレードをターゲットします。

LatticeECP2M1
バス幅 IPexpress モード SLICEs LUTs レジスタ sysMEM EBRs 外部端子 fMAX (MHz)
32-ビット マスター/ターゲット 33 MHz 856 1068 642 - 50 33
32-ビット マスター/ターゲット 66 MHz 1086 1700 663 - 50 66

1. パフォーマンスと使用率データは、ラティスDiamond 1.0 ソフトウェアと、LFE2M-35E-6F672C デバイスを使用して生成されます。パフォーマンスが異なる場合があります別のソフトウェア バージョンを使用してまたは LatticeECP2M 家族の内で別のデバイス密度や速度のグレードをターゲットします。

LatticeECP21
バス幅 IPexpress モード SLICEs LUTs レジスタ sysMEM EBRs 外部端子 fMAX (MHz)
32-ビット マスター/ターゲット 33 MHz 856 1068 642 - 50 33
32-ビット マスター/ターゲット 66 MHz 1086 1700 663 - 50 66

1. パフォーマンスと使用率データは、ラティスDiamond 1.0 ソフトウェアと、LFE2-20E-6F672C デバイスを使用して生成されます。パフォーマンスが異なる場合があります別のソフトウェア バージョンを使用してまたは LatticeECP2 家族の内で別のデバイス密度や速度のグレードをターゲットします。

LatticeEC/P1
バス幅 IPexpress モード SLICEs LUTs レジスタ sysMEM EBRs 外部端子 fMAX (MHz)
32-ビット マスター/ターゲット 33 MHz 846 1060 642 - 50 33
32-ビット マスター/ターゲット 66 MHz 1083 1690 663 - 50 66

1. パフォーマンスと使用率データは、ラティスDiamond 1.0 ソフトウェアと、LFEC33E-5F672C デバイスを使用して生成されます。パフォーマンスが異なる場合があります別のソフトウェア バージョンを使用してまたは LatticeECP/EC 家族の内で別のデバイス密度や速度のグレードをターゲットします。

LatticeSC1
バス幅 IPexpress モード SLICEs LUTs レジスタ sysMEM EBRs 外部端子 fMAX (MHz)
32-ビット マスター/ターゲット 33 MHz 724 1050 640 - 50 33
32-ビット マスター/ターゲット 66 MHz 1085 1722 663 - 50 66

1. パフォーマンスと使用率データは、ラティスDiamond 1.0 ソフトウェアと、LFSC3GA25E-6F900C デバイスを使用して生成されます。パフォーマンスが異なる場合があります別のソフトウェア バージョンを使用してまたは LatticeSC 家族の内で別のデバイス密度や速度のグレードをターゲットします。

MachXO21
バス幅 IPexpress モード SLICEs LUTs レジスタ sysMEM EBRs 外部端子 fMAX (MHz)
32-ビット マスター/ターゲット 33 MHz 406 803 582 - 50 33

1. パフォーマンスと使用率データは、ラティスDiamond 1.0 ソフトウェアと、LCMXO2-1200HC-6TG144CES デバイスを使用して生成されます。パフォーマンスが異なる場合があります別のソフトウェア バージョンを使用してまたは MACHXO2 家族の内で別のデバイス密度や速度のグレードをターゲットします。

MachXO1
バス幅 IPexpress モード SLICEs LUTs レジスタ sysMEM EBRs 外部端子 fMAX (MHz)
32-ビット マスター/ターゲット 33 MHz 542 1060 642 - 50 33

1. パフォーマンスと使用率データは、ラティスDiamond 1.0 ソフトウェアと、LCMXO2280C-5FT324C デバイスを使用して生成されます。パフォーマンスが異なる場合があります別のソフトウェア バージョンを使用してまたは MACHXO 家族の内で別のデバイス密度や速度のグレードをターゲットします。

LatticeXP21
バス幅 IPexpress モード SLICEs LUTs レジスタ sysMEM EBRs 外部端子 fMAX (MHz)
32-ビット マスター/ターゲット 33 MHz 851 1060 640 - 50 33
32-ビット マスター/ターゲット 66 MHz 1081 1692 661 - 50 66

1. パフォーマンスと使用率データは、ラティスDiamond 1.0 ソフトウェアと、LFXP2-17E-6F484C デバイスを使用して生成されます。パフォーマンスが異なる場合があります別のソフトウェア バージョンを使用してまたは LatticeXP2 家族の内で別のデバイス密度や速度のグレードをターゲットします。

LatticeXP1
バス幅 IPexpress モード SLICEs LUTs レジスタ sysMEM EBRs 外部端子 fMAX (MHz)
32-ビット マスター/ターゲット 33 MHz 846 1060 642 - 50 33
32-ビット マスター/ターゲット 66 MHz 1083 1690 663 - 50 66

1. パフォーマンスと使用率データは、ラティスDiamond 1.0 ソフトウェアと、LFXP20C-5F484C デバイスを使用して生成されます。パフォーマンスが異なる場合があります別のソフトウェア バージョンを使用してまたは LatticeXP 家族の内で別のデバイス密度や速度のグレードをターゲットします。

発注情報

家族 バス幅 バス速度 パートナンバー
LatticeECP3 32-ビット 33MHz, 66MHz PCI-MT32-E3-U6
LatticeECP2M 32-ビット 33MHz, 66MHz PCI-MT32-PM-U6
LatticeECP2 32-ビット 33MHz, 66MHz PCI-MT32-P2-U6
LatticeECP/EC 32-ビット 33MHz, 66MHz PCI-MT32-E2-U6
LatticeSC 32-ビット 33MHz, 66MHz PCI-MT32-SC-U6
MachXO2 32-ビット 33MHz PCI-MT32-M2-U1
MachXO 32-ビット 33MHz PCI-MT32-XO-U6
LatticeXP2 32-ビット 33MHz, 66MHz PCI-MT32-X2-U6
LatticeXP 32-ビット 33MHz, 66MHz PCI-MT32-XM-U6

IP バージョン: PCI Master/Target 33MHz = 6.6, PCI Master/Target 66MHz = 6.4

このIPの完全な評価バージョンをダウンロードするには、IPexpressメイン・ウィンドウのラティスIPサーバ・タブへ行ってください。ダウンロード可能な全てのispLeverCORE IPモジュールがこのタブ上に表示されます。

IP コアを購入する方法を見つけるためにローカル格子営業所までご連絡ください。

ドキュメント

Quick Reference
Information Resources
Downloads
TITLE NUMBER VERSION DATE FORMAT SIZE
PCI IP Core User's Guide
PCI Core User Guide for LatticeSC, LatticeECP3, LatticeECP2/M, LatticeECP/EC, LatticeXP, Mach XO, and MachXO2
IPUG18 9.2 11/8/2010 PDF 4.6 MB
TITLE NUMBER VERSION DATE FORMAT SIZE
IP Module Evaluation Tutorial
8/1/2004 PDF 216.1 KB
TITLE NUMBER VERSION DATE FORMAT SIZE
Evaluation Package for 32 Bit PCI Master/Target for ORCA 4
10/1/2003 ZIP 1.2 MB
Evaluation Package for PCI Master/Target 32-bit / 33MHz for LatticeSC
2/21/2006 ZIP 672.7 KB
Evaluation Package for PCI Master/Target 32-bit / 33MHz for LatticeECP/EC
2/1/2005 ZIP 808.7 KB
Evaluation Package for PCI Master Target 32 bit for LatticeXP - Configuration 2
8/1/2005 ZIP 1.1 MB
Evaluation Package for PCI Master/Target 32-bit / 66MHz for LatticeSC
2/21/2006 ZIP 1 MB
Evaluation Package for 32 Bit PCI Master/Target for MachXO
12/1/2005 ZIP 649.8 KB
Evaluation Package for PCI Master/Target 32-bit / 33MHz for LatticeXP
5/1/2005 ZIP 658.3 KB
Evaluation Package for 32 Bit PCI Master/Target for ispXPGA
9/1/2003 ZIP 2.2 MB
Evaluation Package for PCI Master Target 32 for ECP/EC Configuration 2
8/1/2005 ZIP 1 MB
Evaluation Package for 32 Bit PCI Master/Target for ORCA 4 - Configuration 2
11/1/2003 ZIP 2.2 MB

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