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// >>>>>>>>>>>>>>>>>>>>>>>>> COPYRIGHT NOTICE <<<<<<<<<<<<<<<<<<<<<<<<<
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// Copyright 2002 (c) Lattice Semiconductor Corporation
// ALL RIGHTS RESERVED
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// This confidential and proprietary software may be used only as
// authorised by a licensing agreement from Lattice Semiconductor
// Corporation.
// The entire notice above must be reproduced on all authorized
// copies and copies may only be made to the extent permitted
// by a licensing agreement from Lattice Semiconductor Corporation.
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// File Details
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// Project              :       ORSPII
// Filename             :       addr_params.v
// Author               :       Rob Proudlock, rproudlo@latticesemi.com
// Created on           :       Wednesday 10th July 2002
// Last Modified By     :       $Author: rproudlo $
// Last Modified On     :       $Date: Thu Aug 15 09:49:43 2002 $ 
// Revision             :       $Revision: 1.2 $
// Status               :       Development
// Dependencies         :       None
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// Description          :
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// This module lists the addresses of the SPI4.2 No.1 ASB
//
//
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// Revision History
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// $Log: addr_params.v.rca $
// 
//  Revision: 1.2 Thu Aug 15 09:49:43 2002 rproudlo
//  Updated after initial verification
// 
//  Revision: 1.1 Wed Jul 10 11:17:24 2002 rproudlo
//  Initial Creation
// 
// 
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//Address Map SPI4.2 Number 1
//Base Addr = 18'h30900

//Control Registers

parameter CALENDAR_M_RX_A = 18'h30900;

parameter CALENDAR_LEN_RX_A1 = 18'h30901;
parameter CALENDAR_LEN_RX_A2 = 18'h30902;

parameter MAX_CALENDAR_LEN_RX_A1 = 18'h30903;
parameter MAX_CALENDAR_LEN_RX_A2 = 18'h30904;

parameter CALENDAR_M_TX_A = 18'h30905;

parameter CALENDAR_LEN_TX_A1 = 18'h30906;
parameter CALENDAR_LEN_TX_A2 = 18'h30907;

parameter MAX_CALENDAR_LEN_TX_A1 = 18'h30910;
parameter MAX_CALENDAR_LEN_TX_A2 = 18'h30911;

parameter FIFO_THRESHOLD_H_RX_A = 18'h30912;

parameter MAX_BURST1_A1 = 18'h30913; 
parameter MAX_BURST1_A2 = 18'h30914; 

parameter MAX_BURST2_A1 = 18'h30915; 
parameter MAX_BURST2_A2 = 18'h30916; 

parameter LIMIT_LOSS_TRN_BAS_EN_A = 18'h30917;

parameter DATA_MAX_T_A1 = 18'h30920;
parameter DATA_MAX_T_A2 = 18'h30921;
parameter DATA_MAX_T_A3 = 18'h30922;
parameter DATA_MAX_T_A4 = 18'h30923;

parameter ALPHA_A1 = 18'h30924;
parameter ALPHA_A2 = 18'h30925;

parameter RDI_INT_EN_A = 18'h30926;

parameter SOP_DIP_AFIFO_INT_EN_A = 18'h30927;

parameter ALARM_INT_EN_A = 18'h30930;

parameter DPRAM_0_RXFIFO_P_OVERRUN_INT_EN_A = 18'h30931;
parameter DPRAM_1_RXFIFO_P_OVERRUN_INT_EN_A = 18'h30932;
parameter DPRAM_2_RXFIFO_P_OVERRUN_INT_EN_A = 18'h30933;
parameter DPRAM_3_RXFIFO_P_OVERRUN_INT_EN_A = 18'h30934;

parameter DPRAM_0_TXFIFO_P_OVERRUN_INT_EN_A = 18'h30935;
parameter DPRAM_1_TXFIFO_P_OVERRUN_INT_EN_A = 18'h30936;
parameter DPRAM_2_TXFIFO_P_OVERRUN_INT_EN_A = 18'h30937;

parameter DPRAM_3_TXFIFO_P_OVERRUN_INT_EN_A = 18'h30940;

parameter DPRAM_0_RXFIFO_P_URRUN_INT_EN_A = 18'h30941;
parameter DPRAM_1_RXFIFO_P_URRUN_INT_EN_A = 18'h30942;
parameter DPRAM_2_RXFIFO_P_URRUN_INT_EN_A = 18'h30943;
parameter DPRAM_3_RXFIFO_P_URRUN_INT_EN_A = 18'h30944;

parameter DPRAM_0_TXFIFO_P_URRUN_INT_EN_A = 18'h30945;
parameter DPRAM_1_TXFIFO_P_URRUN_INT_EN_A = 18'h30946;
parameter DPRAM_2_TXFIFO_P_URRUN_INT_EN_A = 18'h30947;

parameter DPRAM_3_TXFIFO_P_URRUN_INT_EN_A = 18'h30950;

parameter RX_DPRAM_J_PART_SIZE = 18'h30951;
parameter RX_DPRAM_J_AGGR_MODE = 18'h30952;

parameter TX_DPRAM_J_PART_SIZE = 18'h30953;
parameter TX_DPRAM_J_AGGR_MODE = 18'h30954;

parameter DPRAM_J_FULL_EMPTY_TYPE_SEL_A = 18'h30955;

parameter SPEED_IO_LB_ERR_SEL_A = 18'h30956;

parameter MEM_WR_SEL_A = 18'h30957;

//
//Status Registers
//

parameter RDI_INT_STATUS_A = 18'h30908;

parameter ALARM_SOP_DIP_AFIFO_STATUS_A = 18'h30909;

parameter DIP4_ERR_CNT = 18'h3090a;
parameter DIP2_ERR_CNT = 18'h3090b;

parameter DPRAM_0_RXFIFO_P_OVERRUN_STATUS_A = 18'h3090c;
parameter DPRAM_1_RXFIFO_P_OVERRUN_STATUS_A = 18'h3090d;
parameter DPRAM_2_RXFIFO_P_OVERRUN_STATUS_A = 18'h3090e;
parameter DPRAM_3_RXFIFO_P_OVERRUN_STATUS_A = 18'h3090f;

parameter DPRAM_0_TXFIFO_P_OVERRUN_STATUS_A = 18'h30918;
parameter DPRAM_1_TXFIFO_P_OVERRUN_STATUS_A = 18'h30919;
parameter DPRAM_2_TXFIFO_P_OVERRUN_STATUS_A = 18'h3091a;
parameter DPRAM_3_TXFIFO_P_OVERRUN_STATUS_A = 18'h3091b;

parameter DPRAM_0_RXFIFO_P_URRUN_STATUS_A = 18'h3091c;
parameter DPRAM_1_RXFIFO_P_URRUN_STATUS_A = 18'h3091d;
parameter DPRAM_2_RXFIFO_P_URRUN_STATUS_A = 18'h3091e;
parameter DPRAM_3_RXFIFO_P_URRUN_STATUS_A = 18'h3091f;

parameter DPRAM_0_TXFIFO_P_URRUN_STATUS_A = 18'h30928;
parameter DPRAM_1_TXFIFO_P_URRUN_STATUS_A = 18'h30929;
parameter DPRAM_2_TXFIFO_P_URRUN_STATUS_A = 18'h3092a;
parameter DPRAM_3_TXFIFO_P_URRUN_STATUS_A = 18'h3092b;
