LatticeECP2/M FPGAファミリ

低コストFPGA

FPGAアプリケーション空間の再定義-LatticeECP2とLatticeECP2Mファミリは、最大95KのLUTと最大5.3 MビットのブロックRAMと分散RAMを備えており、以前は高コストのFPGAにしかなかった機能を搭載しています

PCSを使用した高速SERDES-PCI Express、イーサネット (1 GbEおよびSGMII)、OBSAIおよびCPRIを含む一般的なデータプロトコルのアレイに対応するように、ジッター耐性の高い、PCSブロック付き低伝送SERDESを構成できます

電力消費のないパフォーマンス-LatticeECP2/Mファミリが最大840MbpsのLVDS I/O、DDR1/2(533 Mbps)、SPI4.2(750)に対応できないと考えるかもしれませんが、可能です

特長

  • エンベデッドSERDESは最大3.125 Gbpsのデータレートに対応します(LatticeECP2のみ)
  • 高性能の乗算および累算を可能とする最大42個のsysDSP™ブロック
  • 55Kビットから5308KビットsysMEM™エンベデッドブロックRAM(EBR)
  • sysCLOCKアナログPLLおよびDLLにより、クロック乗算、分割、位相&遅延の調整が可能
  • TQFP, PQFPおよびfpBGAパッケージ

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ファミリーテーブル

LatticeECP2セレクションガイド (“S” シリーズを含む)

デバイス ECP2-6 ECP2-12 ECP2-20 ECP2-35 ECP2-50 ECP2-70
LUT数 6 12 21 32 48 68
分散RAM容量 (Kbit) 12 24 42 64 96 136
EBR SRAM容量 (Kbit) 55 221 276 332 387 1032
EBR SRAMブロック数 3 12 15 18 21 56
sysDSPブロック数 3 6 7 8 18 22
18x18乗算器 12 24 28 32 72 88
DLL + PLL 2+2 2+2 2+2 2+2 2+4 2+6
最大ユーザI/O数 190 297 402 450 500 583
パッケージ (I/O数)
144ピン TQFP (20 x 20 mm) 90 93
208ピン PQFP (28 x 28 mm) 131 131
256ボールfpBGA (17 x 17 mm) 190 193 193
484ボールfpBGA (23 x 23 mm) 297 331 331 339
672ボールfpBGA (27 x 27 mm) 402 450 500 500
900ボールfpBGA (31 x 31 mm) 583

LatticeECP2Mセレクションガイド (“S” シリーズを含む)

デバイス ECP2M-20 ECP2M-35 ECP2M-50 ECP2M-70 ECP2M-100
LUT数 19 34 48 67 95
EBR SRAMブロック数 66 114 225 246 288
EBR SRAM容量 (Kbit) 1217 2101 4147 4534 5308
分散RAM容量 (Kbit) 41 71 101 145 202
sysDSPブロック数 6 8 22 24 42
18x18乗算器 24 32 88 96 168
GPLL + SPLL + DLL 2+6+2 2+6+2 2+6+2 2+6+2 2+6+2
最大I/O数 304 410 410 436 520
最大I/O数 SERDES CH数 / IOポート数)
256ボールfpBGA (17 x 17 mm) 4 / 140 4 / 140
484ボール fpBGA (23 x 23 mm) 4 / 304 4 / 303 4 / 270
672ボール fpBGA (27 x 27 mm) 4 / 410 8 / 372
900ボール fpBGA (31 x 31 mm) 8 / 410 16 / 416 16 / 416
1152ボール fpBGA (35 x 35 mm) 16 / 436 16 /520

デザインリソース

IP&リファレンスデザイン

プレテスト、再利用可能な機能を利用して設計の労力を軽減

アプリケーションノート

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ソフトウェア

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開発キット&ボード

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