CrossLink-NX: エンベデッドビジョン&プロセッシングFPGA

MIPI ブリッジ & エッジ AI の組み合わせを実現

ラティス・ネクサス・プラットフォーム – 同クラスのFPGAと比較して最大 75% 低消費電力、4 mm x 4 mm の小型パッケージサイズ

画像処理アプリケーションのためのクラス最高性能を提供 – ロジック当たり最大の内蔵メモリ量、最大 1 ロジックセル当たり 170 ビット、AI 推論に最適

高速インタフェース – 2.5 Gbps ハードウェア MIPI D-PHY、5 Gbps PCIe、1.5 Gbps プログラマブル IO、1066 Mbps DDR3。LVDS、subLVDS、OpenLDI (OLDI)、SGMII、FPGA ファブリックは多重・複製・分岐を実現

機能

  • 高速起動 (インスタントオン) – 3 ms で IO を起動、8 ms でデバイスを起動
  • プログラム可能な FD-SOI バックバイアスがデバイス毎にパフォーマンスと電力の最適化
  • ハードウェア MIPI D-PHY (4レーン) トランシーバを2つ実装、1つの PHY で 10 Gbps
  • カメラ、ディスプレイインタフェース用に最大 37 プログラマブル・ソースシンクロナス I/O ペア
  • 4 mm x 4 mm WLCS パッケージ (0.4 mm ピッチ) から 17 mm x 17 mm BGA パッケージ (0.8 mm ピッチ)
  • クラス最小のソフトエラーレート、競合と比較して 100 倍上回る信頼性

各項目へのリンク

ファミリーテーブル

CrossLink-NX デバイス セレクション ガイド
機能 LIFCL-17 LIFCL-40
ロジックセル 17K 39K
エンベデッドメモリ (EBR) Bits (Kb) 432 1512
ラージメモリ (LRAM) Bits (Kb) 2560 1024
18 x 18 乗算器 24 56
ADC ブロック 2 2
GPLL 2 3
HW 10 Gbps D-PHY クアッド 2 2
HW 2.5 Gbps D-PHY データレーン (合計) 8 8
5 Gb/s PCIe Gen2 ハード IP 1
0.4 mm Total I/O (D-PHY, PCIe, ワイドレンジ, ハイパフォーマンス)

LIFCL-17 LIFCL-40
72 wlcsp (3.7 x 4.1 mm) 40 (1, 0, 16, 24)
0.5 mm Total I/O (D-PHY, PCIe, ワイドレンジ, ハイパフォーマンス)

LIFCL-17 LIFCL-40
72 QFN (10 x 10 mm) 40 (1, 0, 18, 22) 40 (1, 0, 18, 22)
121 csfBGA (6 x 6 mm) 72 (2, 0, 24, 48) 72 (2, 0, 24, 48)
289 csfBGA (9.5 x 9.5 mm) 180 (2, 1, 106, 74)
0.8 mm Total I/O (D-PHY, PCIe, ワイドレンジ, ハイパフォーマンス)

LIFCL-17 LIFCL-40
256 caBGA (14 x 14 mm) 78 (2, 0, 30, 48) 163 (2, 1, 89, 74)
400 caBGA (17 x 17 mm) 192 (2, 1, 118, 74)

ソリューション

エッジ AI コンパニオン

  • 1 つまたは複数の CSI-2 イメージセンサーをプロセッサインタフェース (PCIe、CMOS、CSI-2) に変換
  • プロセッシング用に最大 3 Mbit の内蔵RAM
  • 物体検知や物体カウントのための CPU 処理をオフロード
  • シングルデバイスによる複数画像入力の結合とエッジ AI 処理を実現

センサ・アグリゲーション

  • 最大 14 の MIPI CSI-2 イメージセンサ入力を 1 つの MIPI CSI-2 出力
  • データを結合し水平方向拡張したビデオを生成
  • 外部 DDR メモリを用いてデータを結合し垂直方向に拡張したビデオを生成
  • 個別のバーチャル・チャネルを用いてイメージセンサからのデータを多重
  • 限定されたプロセッサのセンサインタフェース(機能・数)を拡張

イメージセンサ・プロセッシング

  • 1つまたは複数の CSI-2 イメージセンサーをプロセッサインタフェースに変換(PCIe、CMOS、CSI-2)
  • フル機能のビデオ処理を統合
  • 例: DeBayer、Color Correction Matrix、RGB Gain、Gamma Correction、その他
  • プロセッサから ISP 機能を軽減

信号の分岐と複製

  • CSI-2 / DSI 入力信号を分岐・複製し複数のビデオを出力(最大 14 )
  • 安全性を重要とするアプリケーションのセンサーデータに冗長性を提供
  • つの入力を複数のディスプレイ出力が必要とするアプリケーションを簡素化

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Introducing CrossLink-NX

CrossLink-NX FPGA is the first family of FPGAs implemented on the new Lattice Nexus Platform. CrossLink-NX provides the energy efficiency, small form factor, high reliability and higher performance developers need to enable innovative embedded vision solutions for the Edge.
CrossLink-NX: Power Efficiency DemoExpand Image

CrossLink-NX: Power Efficiency Demo

This demonstration measures the power consumption of Lattice’s CrossLink-NX FPGAs relative to other similar FPGAs using commercially available boards.
CrossLink-NX: Instant On DemoExpand Image

CrossLink-NX: Instant On Demo

This demonstration measures the IO wakeup time of Lattice’s CrossLink-NX FPGAs relative to other similar FPGAs using commercially available development boards.
CrossLink-NX: Embedded Vision DemoExpand Image

CrossLink-NX: Embedded Vision Demo

This demonstration shows a development board equipped with a CrossLink-NX FPGA, based on the Lattice Nexus platform. The FPGA has been programmed to perform camera aggregation, which is a common embedded vision use case found in many applications.
CrossLink-NX: Human Presence DemoExpand Image

CrossLink-NX: Human Presence Demo

This demonstration shows a development board equipped with a CrossLink-NX FPGA, based on the Lattice Nexus platform. The FPGA has been programmed to perform human presence detection and counting, which is a common AI use case found in many applications.

Design Resources

開発キット&ボード

当社の開発キットとボードで設計プロセスの合理化

IP & リファレンスデザイン

事前検証済み、開発期間を短縮

アプリケーションノート

製品を最大限活用するための資料

開発ソフトウェア

使いやすく、開発に必要な機能を提供

資料

Quick Reference
Technical Resources
Information Resources
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TITLE NUMBER VERSION DATE FORMAT SIZE
CrossLink-NX High-Speed I/O Interface
FPGA-TN-02097 1.0 12/10/2019 PDF 4.5 MB
CrossLink-NX Hardened D-PHY Usage Guide
FPGA-TN-02081 1.0 12/10/2019 PDF 1.2 MB
Power Management and Calculation for CrossLink-NX Devices
FPGA-TN-02075 1.0 12/10/2019 PDF 1.1 MB
CrossLink-NX Hardware Checklist
FPGA-TN-02149 1.0 1/27/2020 PDF 1 MB
CrossLink-NX Single Event Upset (SEU) Report
FPGA-TN-02174 1.0 1/28/2020 PDF 760.8 KB
Thermal Management
FPGA-TN-02044 3.5 12/10/2019 PDF 1.2 MB
CrossLink-NX LIFCL-40 Pinout
1.1 5/20/2020 CSV 35.4 KB
CrossLink-NX Family Data Sheet
FPGA-DS-02049 0.81.01 5/1/2020 PDF 2.9 MB
Advanced Configuration Security Usage Guide for Nexus Platform
FPGA-TN-02176 1.2 6/24/2020 PDF 2.9 MB
I2C Hardened IP Usage Guide for Nexus Platform
FPGA-TN-02142 1.1 6/24/2020 PDF 1.4 MB
sysCONFIG Usage Guide for Nexus Platform
FPGA-TN-02099 1.1 6/24/2020 PDF 2.4 MB
Memory Usage Guide for Nexus Platform
FPGA-TN-02094 1.1 6/24/2020 PDF 2.3 MB
sysCLOCK PLL Design and Usage Guide for Nexus Platform
FPGA-TN-02095 1.2 6/24/2020 PDF 1.8 MB
sysDSP Usage Guide for Nexus Platform
FPGA-TN-02096 1.1 6/24/2020 PDF 1.6 MB
Soft Error Detection (SED)/Correction (SEC) Usage Guide for Nexus Platform
FPGA-TN-02076 1.1 6/24/2020 PDF 1005.1 KB
TransFR Usage Guide for Nexus Platform
FPGA-TN-02173 1.1 6/24/2020 PDF 813.8 KB
Using TraceID
FPGA-TN-02084 2.0 6/24/2020 PDF 815 KB
ADC Usage Guide for Nexus Platform
FPGA-TN-02129 1.2 6/24/2020 PDF 1.4 MB
Sub-LVDS Signaling Using Lattice Devices
FPGA-TN-02028 1.8 6/24/2020 PDF 1 MB
sysI/O Usage Guide for Nexus Platform
FPGA-TN-02067 1.1 6/24/2020 PDF 1.2 MB
Multi-Boot Usage Guide for Nexus Platform
FPGA-TN-02145 1.1 5/31/2020 PDF 1.2 MB
Lattice Memory Mapped Interface (LMMI) and Lattice Interrupt Interface (LINTR) User Guide
FPGA-UG-02039 1.2 1/31/2020 PDF 1.7 MB
PCB Layout Recommendations for BGA Packages
FPGA-TN-02024 4.1 5/20/2019 PDF 4.6 MB
Package Diagrams
FPGA-DS-02053 5.8 6/24/2020 PDF 20.2 MB
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CrossLink-NX Family Data Sheet
FPGA-DS-02049 0.81.01 5/1/2020 PDF 2.9 MB
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CrossLink-NX High-Speed I/O Interface
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CrossLink-NX Hardware Checklist
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CrossLink-NX Single Event Upset (SEU) Report
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Thermal Management
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Advanced Configuration Security Usage Guide for Nexus Platform
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I2C Hardened IP Usage Guide for Nexus Platform
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sysCONFIG Usage Guide for Nexus Platform
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Memory Usage Guide for Nexus Platform
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sysCLOCK PLL Design and Usage Guide for Nexus Platform
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Soft Error Detection (SED)/Correction (SEC) Usage Guide for Nexus Platform
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Sub-LVDS Signaling Using Lattice Devices
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Multi-Boot Usage Guide for Nexus Platform
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PCB Layout Recommendations for BGA Packages
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Lattice Memory Mapped Interface (LMMI) and Lattice Interrupt Interface (LINTR) User Guide
FPGA-UG-02039 1.2 1/31/2020 PDF 1.7 MB
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Lattice OrCAD Capture Schematic Library (OLB)
This file contains an OrCAD Capture Schematic Library (OLB file type) for all Lattice products. This .zip file also includes a .xls worksheet with a list of the contents of the OLB. These symbols can be used to help with OrCAD schematic designs.
6.7 6/24/2020 ZIP 3.2 MB
TITLE NUMBER VERSION DATE FORMAT SIZE
CrossLink-NX Product Brochure
I0269 1.0 12/11/2019 PDF 597.4 KB
Product Selector Guide
I0211 25.0 10/23/2019 PDF 8.7 MB
TITLE NUMBER VERSION DATE FORMAT SIZE
ラティス CrossLink-NX:エッジでのエンベデッドビジョ ン プロセッシング
1.0 1/18/2020 PDF 629.8 KB
TITLE NUMBER VERSION DATE FORMAT SIZE
[BSDL] LIFCL-40
1.0 12/11/2019 ZIP 21.3 KB
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CrossLink-NX Device Family DELPHI Models
1.0 12/10/2019 ZIP 172.1 KB
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[IBIS] LIFCL-40
1.0 12/11/2019 ZIP 10.5 MB


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